51单片机函数信号发生器设计+原理框图+流程图+源代码 第6页
图4-5 串行控制字装入时序 图4-6为AD9850函数信号发生模块主电路原理图。模块中，单片机与AD9850采用串行连接方式，即单片机AT89S52的P2.5、P2.6、P2.7分别与AD9850的D7（串行控制字输入口中）、WCLK（控制字装入时钟）、FQUD（频率更新控制）相连接。
图4-6 AD9850函数信号发生模块主电路原理图
4.5.2 AD9850模块时钟电路
模块的时钟频率由外部有源晶振100M提供，有源晶振的接法如图4-7所示，因此由公式(2-1) 推出我们所需函数信号的频率所对应的控制字为 (4-1)
图4-7 AD9850函数信号发生模块输入时钟图
4.5.3 AD9850模块输入输出口定义
为了信号的稳定输出，避免外部电流的干扰，以及系统的接口方便和整体布局的简洁，AD9850模块单独采用两面PCB板，电源和地线分两面走线和敷铜，后整个模块统一输入与输出口，其输入输出口定义如图4-8所示：
图4-8 AD9850函数信号发生模块输入输出接口图
4.6 AT89S52单片机ISP下载线
4.6.1 ISP简介
ISP（In-System Programming）在系统可编程，指电路板上的空白器件可以编程写入最终用户代码， 而不需要从电路板上取下器件，已经编程的器件也可以用ISP方式擦除或再编程,ISP技术是未来发展方向。
ISP下载部份支持的芯片列表：
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AT89S51,AT89S52,AT89S53,AT89S8252,AT89LS51,AT89LS52,AT89LS53,AT89LS8252
4.6.2 AT89S52单片机ISP下载线原理
AT89S52引脚图的P1.5、P1.6、P1.7的第二功能分别为MOSI（主机发送从机接收）、MISO（主机接收从机发送）、SCK（时钟脉冲信号由主机发送）。那什么时候才能启用第二功能呢？就是当复位脚RST接高电平一直处于复位状态时就可用第二功能了，所以在ISP下载板上有一条线接至AT89S52的第9脚（RST）上，就是在写程序前先发一个高电平将S51的RST脚设为复位态，然后就可通过MOSI、MISO向S51内写程序了。具体原理图如图4-9所示 毕业论文
http://www.751com.cn图4-9 单片机AT89S52 ISP下载线原理图
图中74HC373为三态输出的八D透明锁存器。当三态允许控制端 OE 为低电平时，Q0~Q7 为正常逻辑状态，可用来驱动负载或总线；当 OE 为高电平时，Q0~Q7 呈高阻态，即不驱动总线，也不为总线的负载，但锁存器内部的逻辑操作不受影响。
当锁存允许端 LE 为高电平时，Q随数据D而变。当LE为低电平时，Q被锁存在已建立的数据电平；当 LE 端施密特触发器的输入滞后作用，使交流和直流噪声抗扰度被改善 400mV。
之所以要用到74HC373，是因为提供足够的驱动电流；保护并口；利用第三态（即高阻态）确保在下载完程序后释放总线，不影响单片机ISP端口的其他功能的正常使用。
4.6.3 电脑并口DB25引脚定义说明
1 选通 (STROBE低电平) 10 确认 (ACKNLG低电平)
2 数据位0 (DATAO) 11 忙 (BUSY)
3 数据位1 (DATA1) 12 却纸 (PE)
4 数据位2 (DATA2) 13 选择 (SLCT)
5 数据位3 (DATA3) 14 自动换行 (AUTOFEED低电平)
6 数据位4 (DATA4) 15 错误观点(ERROR低电平)
7 数据位5 (DATA5) 16 初始化成(INIT低电平)
8 数据位6 (DATA6) 17 选择输入 (SLCTIN低电平)
9 数据位7 (DATA7) 18-25 地线路(GND)
硬件做好后，我们最终的目的只是用它来烧录单片机AT89S52的程序，所以我们用网络上流行的isplay 1.5来进行烧录，关于其使用方法将在后续详细介绍。
4.7 小结
在接到毕业设计题目-基于单片机的函数信号发生器时，我考虑了很久，清楚知道系统硬件设计是本次设计的首先要解决的问题，经过到图书馆查很多相关的资料，经过张老师的指导，而且我对单片机的爱好，最后确定了这个单片机直接控制DDS专业函数信号发生芯片的方案。方案定下来之后，我进一步分析它的可行性，通过进一步的专项资料查找，我进一步优化了系统的设计，包括元器件的选择也做了详细的筛选，最后才确立了最终方案。方案确定后，我便开始采购元器件，着手焊接电路板，边焊接边测试电路的导通情况。焊好的部分电路我都会采用小软件烧入测试的方式检验电路板各个端点电气性是否满足设计要求。经过自己的努力，我成功的焊接好了各个元器件，为后面的软件总体调试打下了坚实的基础。
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