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汽车速度控制系统(框图+电路图+流程图+源程序) 第3页

更新时间:2010-6-23:  来源:毕业论文
汽车速度控制系统(框图+电路图+流程图+源程序) 第3页
  (5)INTR(输入):可屏蔽中断请求输入线,高电平有效。
     (6)RD(输出,三态):读命令(或叫作读选通)信号,低电平有效,此信号启动一次数据从存储器或输入输出设备读入处理器中的过程。
(7)CLK(输入):时钟信号,占空比1:3,由外部时钟产生电路提供。
    (8)RESET(输入):复位信号,它至少保持4个时钟周期的高电平,使处理器停止正在进行的操作,并使标志寄存器、IP、DS、SS、ES和指令队列置0,代码段寄存器CS置成FFFFH(全“l”)。因此复位信号有效作用后.处理器从FFFFOH存储单元取指令并开始执行。 
    (9)READY(输入):准备好信号。处理器在进行存储器或输入输出设备的访问时,不断检测READY引脚的状态。在被访问者没有完成数据传送之前READY引脚处于低电平(无效电平),处理器自动在操作过程中插入一个或几个等待状态来延长访问过程。
    (10)TEST(输入):测试信号,低电平有效。当处理器执行WAIT指令时,每隔5 个时钟周期对于面引脚进行一次测试。如果是高电平,处理器仍处于等待状态;为低电平时,处理器脱离等待状念。
    (11)MN/MX(输入):最大/最小工作模式的选择信号。
    (12)VCC(输入):处理器的电源输入引脚,接十5V电源。
   (13)GND:处理器的地线引脚,接至系统地线。
最小工作模式下的有关控制引脚信号
    (1)INTA(输出):最小工作模式的中断响应信号。
    (2)ALE(输出):地址锁存允许(选通)信号。   
    (3)DEN(输出、三态):数据允许信号,用来控制数据总线双向缓冲器的接通与断开,低电平有效。
    (4)DT/R(输出,三态):数据发送/接收控制信号。DT/R为高电平时,缓冲器发送数据(写),当DT/R为低电平时,缓冲器接收数据(读)。
    (5)M/IO(输出,三态):存储器、输入输出设备的选择信号。高电平则表明访问操作是对存储器的,为低电平则访问操作是对输入输出设备的。
    (6)WR(输出,三态):写命令信号,低电平有效。
    (7)HOLD(输入):总线请求信号,高电平有效,当处理器以外主模块需要使用总线时发出HOLD有效信号,直至总线使用完毕时释放总线并撤消HOLD信号。
(8)HLDA(输出):总线请求响应信号,高电平有效。当占用总线的主模块收到HOLD请求信号后,在完成当前总线操作后发出HLDA有效信号,表明申请使用总线的其他主模块可以使用总线。
(9)SS0(输出):8080最小模式下周期状态信号
最大工作模式下的有关控制引脚信号
(1)     QS1、QS0(输出):指令队列状态信号,用于表示当前指令队列的状态。
      0 0  :无操作                      0 1 :取第一字节
      1 0  :队列空                      1 1 :取后续字节
   (2)S2、S1、S0(输出,三态):最大模式下总线周期状态信号。这三个信号送给8288总线控制器,8288输出各种操作的控制信号。
   (3)LOCK((输出,三态):总线封锁信号。
   (4)RQ/GT0、RQ/GT1(输入输出):最大模式下的总线请求/总线响应信号。
   RQ/GT0优先级高于RQ/GT1。
毕业论文http://www.751com.cn/送入不同的值来控制Y0~Y7的线选。我们这个系统就是用74LS138来实现地址扩展。下表为74LS138的真值表:
 地址线A2、A3、A4送入译码器输出Y0、Y1来控制ADC0809与DAC0832端口地址。
 存储器扩展地址范围
8088     A19 A18 …A0
74LS138  G1  G2A G2B C B A
62256(1)     CS            A15A14A13
62256(2)     CS            A15A14A13
根据以上表格可以得知,62512(1)的地址范围为:62512(1)的地址范围为:
由于8088复位以后,CS=0FFFFH,IP=0000H,PA0=
经过分析可知:                         图1 8088综合模块图
 3.2 8255人机接口模块
3.2.1  I/O接口模块功能
CPU与I/O设备之间的连接及信息处理本文源自辣文论文网和CPU与存储器之间的连接及信息处理相类似。但实际上,I/O设备的种类繁多,CPU与其交换信息相比之下更为复杂,因此,通常I/O设备并不直接与CPU进行信息交换,而是通过相应的I/O接口来进行的。I/O接口是CPU与I/O设备之间进行信息交换的环节。
3.2.2  I/O接口模块组成
    键盘,发光二极管,74LS138译码器组成。
    INTEL 8255A 是可编程通用并行接口芯片,具有两个8位(A和B口)和两个4位(C口高/低四位),通过读写PA,PB,PC三口状态实现信息交换。
74LS138是3-8译码器,通过给ABC送入不同的值来控制Y0~Y7的线选。这个系统就是用74LS138来实现地址扩展。地址线A2~A7送入译码器输出Y0来控制8255A各端口地址。
由电路图可知8255A的各端口地址分别为:0020H、0021H、 0022H、0023H。

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